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<p class="msipheaderdf3d92d6" style="margin:0cm"><span style="font-size:10.0pt;font-family:"Arial",sans-serif;color:blue">[AMD Official Use Only - General]</span><o:p></o:p></p>
<p class="MsoNormal"><o:p> </o:p></p>
<div>
<div>
<p class="MsoNormal"><o:p> </o:p></p>
<div>
<p class="xmsonormal"> correct the cache information for gfx1036<o:p></o:p></p>
<p class="xmsonormal"> <o:p></o:p></p>
<p class="xmsonormal"> Signed-off-by: Yifan Zhang <a href="mailto:yifan1.zhang@amd.com">
yifan1.zhang@amd.com</a><o:p></o:p></p>
<p class="xmsonormal"> <o:p></o:p></p>
<p class="xmsonormal"> Signed-off-by: jie1zhan <a href="mailto:jesse.zhang@amd.com">
jesse.zhang@amd.com</a><o:p></o:p></p>
<p class="xmsonormal"> Change-Id: I60e754737057c144e69a6511ba6ddfca472ca7a1<o:p></o:p></p>
<p class="xmsonormal"> <o:p></o:p></p>
<p class="xmsonormal">diff --git a/drivers/gpu/drm/amd/amdkfd/kfd_crat.c b/drivers/gpu/drm/amd/amdkfd/kfd_crat.c<o:p></o:p></p>
<p class="xmsonormal">index 477a30981c1b..d25ac9cbe5b2 100644<o:p></o:p></p>
<p class="xmsonormal">--- a/drivers/gpu/drm/amd/amdkfd/kfd_crat.c<o:p></o:p></p>
<p class="xmsonormal">+++ b/drivers/gpu/drm/amd/amdkfd/kfd_crat.c<o:p></o:p></p>
<p class="xmsonormal">@@ -795,6 +795,54 @@ static struct kfd_gpu_cache_info yellow_carp_cache_info[] = {<o:p></o:p></p>
<p class="xmsonormal"> },<o:p></o:p></p>
<p class="xmsonormal">};<o:p></o:p></p>
<p class="xmsonormal"> <o:p></o:p></p>
<p class="xmsonormal">+static struct kfd_gpu_cache_info gc_10_3_6_cache_info[] = {<o:p></o:p></p>
<p class="xmsonormal">+ {<o:p></o:p></p>
<p class="xmsonormal">+ /* TCP L1 Cache per CU */<o:p></o:p></p>
<p class="xmsonormal">+ .cache_size = 16,<o:p></o:p></p>
<p class="xmsonormal">+ .cache_level = 1,<o:p></o:p></p>
<p class="xmsonormal">+ .flags = (CRAT_CACHE_FLAGS_ENABLED |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_DATA_CACHE |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_SIMD_CACHE),<o:p></o:p></p>
<p class="xmsonormal">+ .num_cu_shared = 1,<o:p></o:p></p>
<p class="xmsonormal">+ },<o:p></o:p></p>
<p class="xmsonormal">+ {<o:p></o:p></p>
<p class="xmsonormal">+ /* Scalar L1 Instruction Cache per SQC */<o:p></o:p></p>
<p class="xmsonormal">+ .cache_size = 32,<o:p></o:p></p>
<p class="xmsonormal">+ .cache_level = 1,<o:p></o:p></p>
<p class="xmsonormal">+ .flags = (CRAT_CACHE_FLAGS_ENABLED |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_INST_CACHE |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_SIMD_CACHE),<o:p></o:p></p>
<p class="xmsonormal">+ .num_cu_shared = 2,<o:p></o:p></p>
<p class="xmsonormal">+ },<o:p></o:p></p>
<p class="xmsonormal">+ {<o:p></o:p></p>
<p class="xmsonormal">+ /* Scalar L1 Data Cache per SQC */<o:p></o:p></p>
<p class="xmsonormal">+ .cache_size = 16,<o:p></o:p></p>
<p class="xmsonormal">+ .cache_level = 1,<o:p></o:p></p>
<p class="xmsonormal">+ .flags = (CRAT_CACHE_FLAGS_ENABLED |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_DATA_CACHE |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_SIMD_CACHE),<o:p></o:p></p>
<p class="xmsonormal">+ .num_cu_shared = 2,<o:p></o:p></p>
<p class="xmsonormal">+ },<o:p></o:p></p>
<p class="xmsonormal">+ {<o:p></o:p></p>
<p class="xmsonormal">+ /* GL1 Data Cache per SA */<o:p></o:p></p>
<p class="xmsonormal">+ .cache_size = 128,<o:p></o:p></p>
<p class="xmsonormal">+ .cache_level = 1,<o:p></o:p></p>
<p class="xmsonormal">+ .flags = (CRAT_CACHE_FLAGS_ENABLED |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_DATA_CACHE |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_SIMD_CACHE),<o:p></o:p></p>
<p class="xmsonormal">+ .num_cu_shared = 2,<o:p></o:p></p>
<p class="xmsonormal">+ },<o:p></o:p></p>
<p class="xmsonormal">+ {<o:p></o:p></p>
<p class="xmsonormal">+ /* L2 Data Cache per GPU (Total Tex Cache) */<o:p></o:p></p>
<p class="xmsonormal">+ .cache_size = 256,<o:p></o:p></p>
<p class="xmsonormal">+ .cache_level = 2,<o:p></o:p></p>
<p class="xmsonormal">+ .flags = (CRAT_CACHE_FLAGS_ENABLED |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_DATA_CACHE |<o:p></o:p></p>
<p class="xmsonormal">+ CRAT_CACHE_FLAGS_SIMD_CACHE),<o:p></o:p></p>
<p class="xmsonormal">+ .num_cu_shared = 2,<o:p></o:p></p>
<p class="xmsonormal">+ },<o:p></o:p></p>
<p class="xmsonormal">+};<o:p></o:p></p>
<p class="xmsonormal">+<o:p></o:p></p>
<p class="xmsonormal">static void kfd_populated_cu_info_cpu(struct kfd_topology_device *dev,<o:p></o:p></p>
<p class="xmsonormal"> struct crat_subtype_computeunit *cu)<o:p></o:p></p>
<p class="xmsonormal">{<o:p></o:p></p>
<p class="xmsonormal">@@ -1514,11 +1562,14 @@ static int kfd_fill_gpu_cache_info(struct kfd_dev *kdev,<o:p></o:p></p>
<p class="xmsonormal"> num_of_cache_types = ARRAY_SIZE(beige_goby_cache_info);<o:p></o:p></p>
<p class="xmsonormal"> break;<o:p></o:p></p>
<p class="xmsonormal"> case IP_VERSION(10, 3, 3):<o:p></o:p></p>
<p class="xmsonormal">- case IP_VERSION(10, 3, 6): /* TODO: Double check these on production silicon */<o:p></o:p></p>
<p class="xmsonormal"> case IP_VERSION(10, 3, 7): /* TODO: Double check these on production silicon */<o:p></o:p></p>
<p class="xmsonormal"> pcache_info = yellow_carp_cache_info;<o:p></o:p></p>
<p class="xmsonormal"> num_of_cache_types = ARRAY_SIZE(yellow_carp_cache_info);<o:p></o:p></p>
<p class="xmsonormal"> break;<o:p></o:p></p>
<p class="xmsonormal">+ case IP_VERSION(10, 3, 6):<o:p></o:p></p>
<p class="xmsonormal">+ pcache_info = gc_10_3_6_cache_info;<o:p></o:p></p>
<p class="xmsonormal">+ num_of_cache_types = ARRAY_SIZE(gc_10_3_6_cache_info);<o:p></o:p></p>
<p class="xmsonormal">+ break;<o:p></o:p></p>
<p class="xmsonormal"> case IP_VERSION(11, 0, 0):<o:p></o:p></p>
</div>
</div>
</div>
</div>
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