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<p style="font-family:Arial;font-size:10pt;color:#0000FF;margin:5pt;font-style:normal;font-weight:normal;text-decoration:none;" align="Left">
[AMD Official Use Only - General]<br>
</p>
<br>
<div>
<div class="WordSection1">
<p class="MsoNormal"><span style="color:#1F4E79">Reviewed By Zhigang Luo <<a href="mailto:Zhigang.Luo@amd.com">Zhigang.Luo@amd.com</a>><o:p></o:p></span></p>
<p class="MsoNormal"><span style="color:#1F4E79"><o:p> </o:p></span></p>
<p class="MsoNormal"><span style="color:#1F4E79"><o:p> </o:p></span></p>
<div>
<div style="border:none;border-top:solid #E1E1E1 1.0pt;padding:3.0pt 0in 0in 0in">
<p class="MsoNormal"><b>From:</b> Lu, Victor Cheng Chi (Victor) <VictorChengChi.Lu@amd.com>
<br>
<b>Sent:</b> Friday, February 16, 2024 1:50 PM<br>
<b>To:</b> Luo, Zhigang <Zhigang.Luo@amd.com><br>
<b>Subject:</b> Fw: [PATCH 2/4] drm/amdgpu: Do not program SQ_TIMEOUT_CONFIG in SRIOV<o:p></o:p></p>
</div>
</div>
<p class="MsoNormal"><o:p> </o:p></p>
<p style="margin:5.0pt"><span style="font-size:10.0pt;font-family:"Arial",sans-serif;color:blue">[AMD Official Use Only - General]<o:p></o:p></span></p>
<p class="MsoNormal"><o:p> </o:p></p>
<div>
<div>
<p class="MsoNormal"><span style="color:black"><o:p> </o:p></span></p>
</div>
<div class="MsoNormal" align="center" style="text-align:center">
<hr size="2" width="98%" align="center">
</div>
<div id="divRplyFwdMsg">
<p class="MsoNormal"><b><span style="color:black">From:</span></b><span style="color:black"> Lu, Victor Cheng Chi (Victor) <<a href="mailto:VictorChengChi.Lu@amd.com">VictorChengChi.Lu@amd.com</a>><br>
<b>Sent:</b> Tuesday, January 2, 2024 12:30 PM<br>
<b>To:</b> <a href="mailto:amd-gfx@lists.freedesktop.org">amd-gfx@lists.freedesktop.org</a> <<a href="mailto:amd-gfx@lists.freedesktop.org">amd-gfx@lists.freedesktop.org</a>><br>
<b>Cc:</b> Chander, Vignesh <<a href="mailto:Vignesh.Chander@amd.com">Vignesh.Chander@amd.com</a>>; Lu, Victor Cheng Chi (Victor) <<a href="mailto:VictorChengChi.Lu@amd.com">VictorChengChi.Lu@amd.com</a>><br>
<b>Subject:</b> [PATCH 2/4] drm/amdgpu: Do not program SQ_TIMEOUT_CONFIG in SRIOV</span>
<o:p></o:p></p>
<div>
<p class="MsoNormal"> <o:p></o:p></p>
</div>
</div>
<div>
<div>
<p class="MsoNormal" style="margin-bottom:12.0pt">VF should not program this register.<br>
<br>
Signed-off-by: Victor Lu <<a href="mailto:victorchengchi.lu@amd.com">victorchengchi.lu@amd.com</a>><br>
---<br>
 drivers/gpu/drm/amd/amdgpu/gfx_v9_4_3.c | 3 +++<br>
 1 file changed, 3 insertions(+)<br>
<br>
diff --git a/drivers/gpu/drm/amd/amdgpu/gfx_v9_4_3.c b/drivers/gpu/drm/amd/amdgpu/gfx_v9_4_3.c<br>
index 00b21ece081f..30cc155f20d4 100644<br>
--- a/drivers/gpu/drm/amd/amdgpu/gfx_v9_4_3.c<br>
+++ b/drivers/gpu/drm/amd/amdgpu/gfx_v9_4_3.c<br>
@@ -3888,6 +3888,9 @@ static void gfx_v9_4_3_inst_enable_watchdog_timer(struct amdgpu_device *adev,<br>
         uint32_t i;<br>
         uint32_t data;<br>
 <br>
+       if (amdgpu_sriov_vf(adev))<br>
+               return;<br>
+<br>
         data = RREG32_SOC15(GC, GET_INST(GC, 0), regSQ_TIMEOUT_CONFIG);<br>
         data = REG_SET_FIELD(data, SQ_TIMEOUT_CONFIG, TIMEOUT_FATAL_DISABLE,<br>
                              amdgpu_watchdog_timer.timeout_fatal_disable ? 1 : 0);<br>
-- <br>
2.34.1<o:p></o:p></p>
</div>
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</div>
</div>
</div>
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